A Performance Driven Layout Synthesis Approach for Digital CMOS Cell Implementation - INRIA - Institut National de Recherche en Informatique et en Automatique

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Article Dans Une Revue Integration, the VLSI Journal Année : 1993

A Performance Driven Layout Synthesis Approach for Digital CMOS Cell Implementation

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Michel Robert

Fonction : Auteur
PersonId : 938334
IdHAL : michel-robert
ORCID : 0000-0002-5075-2898

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Modélisation et simulation Micro et nanotechnologies/Microélectronique

Nadine Azemard : Connectez-vous pour contacter le contributeur

https://hal-lirmm.ccsd.cnrs.fr/lirmm-00239254

Soumis le : mardi 5 février 2008-11:39:11

Dernière modification le : vendredi 24 mars 2023-14:52:49

Dates et versions

lirmm-00239254 , version 1 (05-02-2008)

Identifiants

HAL Id : lirmm-00239254 , version 1

Citer

Michel Robert, Guy Cathébras, Nadine Azemard, Denis Deschacht, Daniel Auvergne. A Performance Driven Layout Synthesis Approach for Digital CMOS Cell Implementation. Integration, the VLSI Journal, 1993. ⟨lirmm-00239254⟩

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